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基于VHDL与Quartus Ⅱ软件的可编程逻辑器件应用与开发 - 郑燕,赫建国
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第3章　VHDL程序的结构

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2024-04-30 09:02:32
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  • 封面
  • 版权信息
  • 第2版前言
  • 前言
  • 第1章　可编程逻辑器件
    • 目标
    • 引言
    • 1.1　数字集成电路的分类
    • 1.2　标准逻辑器件基础知识
    • 1.3　可编程逻辑器件基础知识
    • 1.4　ALTERA公司的可编程逻辑器件
    • 小结
    • 习题
  • 第2章　Quartus Ⅱ开发软件
    • 目标
    • 引言
    • 2.1　Quartus Ⅱ简介
    • 2.2　Quartus Ⅱ集成开发软件的工作窗口
    • 2.3　创建工程
    • 2.4　设计的输入
    • 2.5　设计的编译
    • 2.6　设计的功能仿真
    • 小结
    • 习题
  • 第3章　VHDL程序的结构
    • 目标
    • 引言
    • 3.1　VHDL语言的产生及发展
    • 3.2　VHDL程序的最简单结构
    • 3.3　实体
    • 3.4　结构体
    • 3.5　VHDL程序的结构
    • 小结
    • 习题
  • 第4章　并行语句
    • 目标
    • 引言
    • 4.1　数据类型
    • 4.2　VHDL的运算符
    • 4.3　基于逻辑门的组合逻辑电路设计
    • 4.4　并行语句基础知识
    • 4.5　三态缓冲器
    • 4.6　编码器
    • 4.7　译码器
    • 4.8　数据选择器与数据分配器
    • 4.9　奇偶产生/校验器
    • 小结
    • 习题
  • 第5章　顺序语句
    • 目标
    • 引言
    • 5.1　顺序语句介绍
    • 5.2　进程语句
    • 5.3　时钟信号的描述
    • 5.4　触发器
    • 5.5　计数器
    • 5.6　分频器
    • 5.7　循环语句
    • 5.8　数据对象
    • 小结
    • 习题
  • 第6章　可编程逻辑器件的编程/配置
    • 目标
    • 引言
    • 6.1　编程/配置模式
    • 6.2　ByteBlaster下载电缆
    • 6.3　可编程逻辑器件的编程/配置
    • 6.4　配置芯片
    • 小结
  • 第7章　状态机
    • 目标
    • 引言
    • 7.1　介绍
    • 7.2　状态机的设计风格
    • 7.3　增强状态机程序的可阅读性
    • 7.4　单一进程的状态机程序
    • 7.5　数字/模拟转换器DAC7611的使用
    • 小结
    • 习题
  • 第8章　Quartus Ⅱ开发软件深入使用
    • 目标
    • 引言
    • 8.1　原理图输入方法
    • 8.2　层次化设计
    • 8.3　存储器的设计
    • 小结
  • 第9章　VHDL的深入使用
    • 目标
    • 引言
    • 9.1　包集
    • 9.2　元件
    • 9.3　函数
    • 9.4　过程
    • 小结
    • 习题
  • 第10章　时钟电路
    • 目标
    • 引言
    • 10.1　时钟产生电路
    • 10.2　锁相环
    • 10.3　锁相环模块的创建
    • 小结
  • 第11章　信号产生器的设计
    • 目标
    • 引言
    • 11.1　概述
    • 11.2　直接数字合成技术
    • 11.3　方案论证
    • 11.4　系统设计
    • 11.5　单元电路设计
    • 11.6　系统连调
    • 小结
  • 第12章　Nios Ⅱ软核处理器
    • 目标
    • 引言
    • 12.1　概述
    • 12.2　配置Nios Ⅱ软核处理器系统
    • 12.3　产生Nios Ⅱ软核处理器系统
    • 12.4　创建Nios Ⅱ IDE环境下的应用工程
    • 12.5　配置目标现场可编程阵列芯片器件
    • 小结
  • 参考文献
  • 内容简介
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